W 2011 roku Intel wprowadził zmodyfikowaną wersję interfejsu – DMI 2.0 – który zwiększył dwukrotnie przepustowość magistrali osiągając 5 GT/s, czyli około 2 GB/s przy wykorzystaniu wszystkich 4 linii danych PCIe v2 i uwzględnieniu kodowania 8b/10b. Magistrala ta została użyta do połączenia procesora z wprowadzoną w 2008 roku Platform Controller Hub (PCH), która zastąpiła Intel Hub Architecture (IHA) opartą na chipsecie składającym się z mostka północnego i mostka południowego.
Magistralę DMI 3.0 wprowadzono w sierpniu 2015 r.i posiada ona przepustowość 8 GT/s na każdej z czterech linii danych, co pozwala w każdym z dwóch kierunków pomiędzy procesorem a PCH przesyłać dane z szybkością do około 3,93 GB/s. Wzrost wydajności uzyskano głównie dzięki zastosowaniu łącza PCIe v3 w miejsce PCIe v2. Łącze DMI 3.0 zostało wprowadzone po raz pierwszy w procesorach Intel Skylake, by powiązać je z chipsetami serii 100, jednak pojawiły się również procesory Skylake modele U i Y, które miały PCH zintegrowane w jednej strukturze krzemowej i korzystały z On Package DMI interconnect Interface (OPI).